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LMK04828 PLL2无法LOCK

2016-06-13接口/时钟阅读(165)赞(0)

TI工程师, 你们好！我在配置LMK04828时，使用单PLL模式（PLL2),P...

2016-06-07接口/时钟阅读(188)赞(0)

04828使用0-delay模式,每次上电的输出的时钟和输入的时钟相位差都不一样,使用的是cascaded 0-delay, pll1的设置是clkin1=100M.clkin1_r = 100,pll1_pdf = 1M,pll1_N= ...

2016-04-19接口/时钟阅读(298)赞(0)

TI的工程师您好：我在使用贵公司的ADC12J2700EVM做设计时，想从LMK04828的OSCin端输入16MHz的时钟，只使用单个PLL，通过PLL2的0-delay模式倍频出2.56GHz的ADC采样时钟和0-delay的SYSR...

2016-04-18接口/时钟阅读(214)赞(0)

TI工程师您好：我在使用贵司的LMK04828芯片做电路设计时，需要输出一路单端LVCMOS时钟信号，但芯片并不支持LVCMOS输出（处理OSCout）差分转单端一般是做阻抗匹配和交流耦合，如下所示但不确定LMK04828的差分转单端...

2016-04-06接口/时钟阅读(182)赞(0)

根据LMK04808手册，锁定指示与设定的鉴相器锁定窗口偏差和锁定计数器设置有关，有个经验公式根据经验公式理论上可以计算出锁定后最大偏差频率，请帮忙看一下附件里面计算方法有没有问题，非常感谢 Sunny Qin：初步看您的计算没有问题...

2016-03-30接口/时钟阅读(191)赞(0)

TI的工程师您好：我在使用贵司的LMK04828做电路设计时，看到datasheet里讲到可设置为单PLL模式，但没看到具体的实现方法，请问是否跟LMK04906的单PLL模式一样，只在OSCin接入晶振即可(只用到PLL2，详细见附件 ...

2015-05-18接口/时钟阅读(220)赞(0)

TI的工程师您好，我公司最近在开发基于JESD204B接口的数据采集电路，在做时钟分配方案的时候采用了您公司的LMK04828，并申请了样片，现在样片已经在路上了，因此我就开始着手画电路板，目前遇到了如下问题： 1.我看LMK04828的开...