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标签:F28377

其他DSP & ARM® 处理器

CLA中断和TIMER0中断问题

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本人在TI例程cla_adc_fir32_cpu01中添加TIMER0中断,增加中断处理的内容,在各个中断进入时拉高相应的管脚电平,在各自处理完内容后又都拉低相应的管脚电平,在测试中发现两个中断相互产生了影响,并不是像手册所说的CLA协处理...