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标签:DP83640

DP83640: DP83640-TI中文支持网
接口/时钟

DP83640: DP83640

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Part Number:DP83640 DP83640芯片配置为100兆、全双工模式,FPGA中与之交互数据的三速以太网IP核在同时收发数据时,偶尔会报CRC错,这个错误原因是因为【该错误帧帧头中帧长度字段值(比如800)与该帧实际字节数(...

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DP83640: 相位对齐

zhixue li阅读(135)赞(0)

Part Number:DP83640 我正在使用DP83640实现1588时钟同步,我已经将PTPD协议栈移植到我的工程中,并且实现了主机和从机的时间同步,我使用主机和从机的GPIO9引脚分别输出1PPS信号,它们的相位差很大,大概有1m...

DP83640: DP83640 MDIO通信异常-TI中文支持网
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DP83640: DP83640 MDIO通信异常

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Part Number:DP83640 使用海思3559A连接的DP83640; 目前的情况是phy运行不稳定,有时候可以发现phy,有时候发现不了; 使用mdio读取phy 的寄存器,发现读取的值有时候是正确的,有时候是错误或者全FFFF...

DP83640: 芯片工作不正常,配置引脚上下拉无法生效-TI中文支持网
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DP83640: 芯片工作不正常,配置引脚上下拉无法生效

James Maxwell阅读(154)赞(0)

Part Number:DP83640 如题,芯片工作不正常,配置引脚上下拉无法生效,具体提现在测量配置引脚的电平时,明明上拉的引脚却是低电平,9个上拉电阻,只有4个正常上拉,剩下5个均为低电平(此处详见附图),且模式确实也未配置正确,本设...