TI中文支持网请教一下为什么LMK04906 用于双锁相环时PLL1无法锁定呢？没有LOS和DAC告警，显示DAC未锁定，PLL1 DLD为低，芯片是直接在EVB上工作的，多谢指导
Robin Feng：
你得EVM哪个得来的,新的么?如果是EVM锁不定,可能是配置或者连接有问题,
请把你的配置放上来,参考是哪个口给的,参考选择是否正确?
xiaojie zhang：
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xiaojie zhang：
回复 Robin Feng:
你好，配置见附件
链接方式是前一个LMK04906作为后一个LMK04906的输入，后一级1通道作为输入，附件是后级的 配置，
两个LMK04906都是EVM板上自带的，从TI订购的，多谢～
xiaojie zhang：
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顶上
Robin Feng：
回复 xiaojie zhang:
你一级环参考是61.44M么?用codeloader打开你的配置后显示锁25M, 但是evm上的VCXO原装是122.88.你确认夏
建议你把coderloader截图贴上来,另外把监相器相位反一下试.
xiaojie zhang：
回复 Robin Feng:
上级是61.44M。我们购买单板上焊接的是25M vcxo，我们原来也以为是122.88M，结果不是的。
刚才测试了一下refrence和out相位，实际是锁上的，但是DAC LOCKDE 和PLL1 DLD还是低，这两个寄存器的判断条件是？现在已经把PLL1_WND_SIZE设置为最大40ns，PLL1_DLD_CNT=1了，coderloader截图在附件中，谢谢
Robin Feng：
回复 xiaojie zhang:
是两块板第一块板能锁,第二块板不能锁么?
你得参考是从clock0输入么?如果是单端输入需要把输入接口设置为CMOS.
xiaojie zhang：
回复 Robin Feng:
你好，
第一块单板没有输入，肯定锁不上，
第二块单板从第一块引入refrence，是差分的信号，测试该单板的输入和输出，发现是锁上的，但是PLL1_DLD和DAC_LOCKDE寄存器显示是低的，这个是怎么回事呢？
谢谢
Robin Feng：
回复 xiaojie zhang:
你好,你目前的测试环境有如下问题:
1.第一块板没有锁定,如何给第二块板作为参考呢?这个没有锁定的时钟是不稳定的.
2.无法只看输出就确定是锁上的,锁定要看锁定指示,就算输出与输入一致，锁定指示没有锁定时间长了也会飘和抖动。
另外lmk04906的evm默认vcxo是122.88M,见下面文档， 建议与你的供应商联系确认是否被修改过；
http://www.ti.com/lit/ug/snau126/snau126.pdf
建议按照正常流程进行测试:
利用信号源提供稳定参考使第一块板可靠锁定,单板正常后再去测试第2块板
谢谢
xiaojie zhang：
回复 Robin Feng:
好的
我想问一下PLL1_DLD和DAC_LOCKED的判决条件是？
