DS90UB941AS-Q1: TI941对DSI源时序要求有那些？

Hi TI:

  客户在使用我司芯片搭配TI941+TI948时，有少数IC出现显示抖动现象，具体现象如下：

  屏timing: pixel clk=147.46MHz, h_act=1920, hfp=64, hbp=32, hsw=32, v_act=1080, vfp=104, vbp=6, vfp=6

  dsi config: 1clock lane+4data lane, dsi clk=445MHz, data rate=890MBps

  客户端1000台大概会有一两台出现抖动现象，量测DSI波形发现正常芯片一帧之前会进入12次LP状态，显示异常的随机进入11或者12次LP，

  调高dsi data rate到905MBps后异常IC也能显示正常。

  我们现在有如下问题需要TI确认：

  1：上述抖动是什么原因导致的？

  2：一帧进11次LP和进12次LP会导致TI941解析时序出错么？

  3：TI941对DSI的时序的具体要求是什么，如DSI的clock以及屏的timing有什么具体约束，需要如何配置来确保显示正常

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