TI中文支持网Part Number:CD4051B
我想问一下CD4051这个料，在单电源应用场景中，VEE引脚悬空状态，会影响什么？供电5V，通过此器件扩展串口。
user5020402：
现在的问题是前期使用是可以正常使用的，但是时间长了，就会出现问题，使用万用表测量时发现通道和地之间的阻抗发生了变化，想问一下这个是为什么？
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Amy Luo：
您好，
通过datasheet以下截图描述，可以知道信号输入管脚和VDD、VEE是有钳位二极管的，VEE悬空相当于信号输入管脚经钳位二极管后悬空。CMOS输入阻抗高，外界的干扰经VEE耦合进入电路后就可能超过信号输入管脚的耐压值，信号输入通道和地之间的阻抗发生了变化，应该是由此形成的输入通道过压造成的
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Amy Luo：
另外附上这类产品不使用管脚的接法视频教程：
https://training.ti.com/ti-precision-labs-switches-and-muxes-can-i-leave-unused-pins-floating?context=1139747-1134454-1140384
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user5020402：
VEE悬空的话，可能会导致信号输入管脚的low电压抬高，但也不至于会超过耐压值吧？
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Amy Luo：
有可能的，CD4051B是CMOS输入，阻抗比较高，一个小的电流耦合至VEE管脚，经CMOS输入电路输入后，就相当于很高的电压输入
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user5020402：
我的供电是5V，即使有一个小的电流耦合至VEE管脚，经CMOS输入之后，最多是能够抬高零点几伏的电压，按照规格书的参数，也是应该在符合范围之内的吧
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Amy Luo：
一个小的电流乘上很大的输入阻抗也会产生很大的电压，况且也可能存在静电，静电打在悬空的VEE上也会造成芯片损坏；这些都是有可能发生的，因此不使用的输入管脚都需要配置为一个固定的电平，不仅CD4051B，其他的芯片也是这样
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mozi mozi：
什么情况下会有如你所说的小电流呢？
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Amy Luo：
您好，有电的地方就存在电磁干扰，电生磁、磁生电是分不开的，因此这个小电流是时时刻刻都存在的，只不过是有大有小，大的时候超过一定临界值就会损坏芯片
