请教做过类似电路的专家:
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原理图见上图。
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MR pin目前挂10k上拉电阻。CT pin挂660nF电容,设计reset 时间为3.7s。
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在目前电路静止的状态下,MR pin有一个2s间隔,270ms宽度的周期性脉冲出现,造成系统不断的复位。
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这颗芯片在另一个项目上使用过,CT是33nF的电容,工作正常。
我把图中的CT电容也更换为33nF的电容,工作也是正常的。但只要我上1颗330nF的电容上去就会出现3描述的现象。
看spec描述,可以支持到10s,不知道问题出现在哪里?
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Delay (s) = CT (nF)/175 + 0.5 x 10-3 (s),公式感觉不太对,请帮忙确认一下具体是如何计算的。
Johnsin Tao:
Hi按照你的意思CT脚上在同样的电路下,较小的电容,按照公式计算正确。大了,就有问题吗?电容较大的时,有没有从信号上确认?
user5332527:
回复 Johnsin Tao:
您好!
对的,使用较小的电容,目前来看,MR输入和reset输出状态都是正常的,CT=33nF,Td的时间大概是3百多ms,感觉按照公式计算出来还不是很准确。但芯片的状态是对的,逻辑是正确的。
而CT上到330nF以后,芯片的逻辑状态就完全不对了。我已经将MR的所有外围器件全部拿掉,只剩下芯片内部的90k上拉,仍然可以看到MR pin本身有个周期性的脉冲信号,造成reset pin一直处于复位的状态。
而spec里面并没有对CT电容的容值极限做详细的描述。前期FAT给我的支持也是CT电容可以按照公式上到10s都可以的。
盼望您的回复。非常感谢!